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  • 10月 11 週一 202102:01

  • 數位邏輯設計Lab2_chellenge

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  • 個人分類：數位邏輯
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  • 10月 10 週日 202117:38

  • 數位系統設計:lab1_challenge

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趴趴熊日常 發表在 痞客邦 留言(0) 人氣(18)

  • 個人分類：數位邏輯
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  • 10月 08 週五 202100:42

  • 數位系統設計:Lab2_basic

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  • 個人分類：數位邏輯
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  • 10月 07 週四 202123:55

  • 數位系統設計:Lab1_basic

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  • 個人分類：數位邏輯
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  • 5月 19 週三 202113:45

  • 實作Verilog--暫存器

image暫存器
–ㄧ群正反器
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  • 個人分類：數位邏輯
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  • 5月 19 週三 202113:20

  • 實作Verilog--使用 T 型正反器之合成法

image3位元的二進位計數器
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  • 個人分類：數位邏輯
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  • 5月 19 週三 202104:09

  • 實作Verilog--莫爾模型

image莫爾模型
輸出值則僅是目前狀態的函數 ， 因為正反器的輸出與時脈同步)
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趴趴熊日常 發表在 痞客邦 留言(0) 人氣(46)

  • 個人分類：數位邏輯
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  • 5月 19 週三 202103:47

  • 實作Verilog--密利模型

image狀態圖
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趴趴熊日常 發表在 痞客邦 留言(0) 人氣(104)

  • 個人分類：數位邏輯
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  • 5月 18 週二 202111:35

  • 實作Verilog--T型正反器

imageT型正反器
–D = T⊕Q = TQ'+T'Q
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  • 個人分類：數位邏輯
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  • 5月 18 週二 202111:15

  • 實作Verilog--JK正反器

imageJK正反器
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